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 在前几篇文章里有给各位说了然若何使用改进算法和低功耗设计步骤，实现高快低功耗的AES ASIC设计。但因篇幅太大，在此自己总结了几个沉点，再向各位介绍一下，以此注明ALPU选取AES128 ASIC的设计在加密系统中是多么的明智。

在介绍之前，我们先要相识一个名称：T盒算法。 

什么是T盒算法呢
？T盒算法是AES的改进算法,如果加密过程中轮变动的输入为a，输出为d，则：上式中SRD（S盒）由有限域GF(28)中的乘法逆变换和GF(2)中的仿射变换复合而成，符号代表有限域GF(28)中的加法运算，符号 代表有限域GF(28)中的乘法运算。 

该实现规划中T0~T3，每个表都蕴含了256个双字，一共占用4KByte的空间。在每次循环迭代中，只有通过4次表查问和4次异或运算，就能急剧地得到一次轮操作中一列的运算了局。改进算法有效降低了关键时序蹊径的传输延长，可能显著的提高ASIC工作频率。通过4次表查问和4次异或运算，就能急剧地得到一次轮操作中一列的运算了局，同时在满足时序约束的前提下，通过动态功耗治理和时钟门控等步骤，凭据芯片的工作状态关关
？榈闹澳懿僮鞑⒐毓厥敝油，达到了降低功耗的主张。

选取T盒算法，设计的数据吞吐率能够提高13.8%，同时选取功耗优化规划后，normal模式下功耗降落了10.7%，在idle模式时更低。该实现规划合用于ECB，CBC等运行模式。选取这种规划，同样也能够使得CMOS功耗变得更低。
  

该规划选取了以下两种低功耗设计步骤。 

1)动态功耗治理 　　

动态功耗治理是一种系统级低功耗设计步骤，降低功耗的重要思路是凭据芯片工作状态扭转功耗治理模式，从而在保障机能的基础上降低功耗。在分歧模式下，时钟的频率能够进行调整，一些空闲
？樯踔琳鲂酒氖敝右部赡芑岜恢粘；鼓芄煌ü髡酒牡缪，进一步降低功耗。由于工作库的限度，本文没有对动态电压治理作进一步的钻研。 

本文选取动态功耗治理，分为normal和idle两种功耗模式。有起头(START)信号时，芯片由idle模式进入normal模式，起头对明文分组加密。经过初始密钥加法和10次轮变换，输出密文分组，并产生实现(STOP)信号，使芯片返回idle模式。因而设计了一个鉴相器产生idle模式的节造信号（EN）。电路由与非门和根基RS触发器组成（图1），对输入信号（起头和实现）的上升沿感应，由D触发器输出EN。拥有结构单一的特点，并对噪声的影响有很好的抑造作用，并能有效地去除毛刺。 

2)时钟门控 　　

EN有关关和打开ASIC内部
？榈淖饔，但这样不是最佳的，由于EN只是关关了内部
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？槟诘氖敝油绻毓，也就是说时钟网络依然处于激活状态，而时钟网络造成的功耗占总功耗的很大部门，只有关关时钟网络能力同时达到关关
？橹澳芎徒档凸牡闹髡。 　　

选取时钟门控技术能够达到关关时钟网络的主张。以图2(a)中所示电路为例，仿真天生的波形如图2(b)所示
Ｄ芄豢吹街挥性贓N信号为1和时钟信号CLK上跳同时产生，ENCLK才会从0变为1，激活时钟网络。在其他时刻，时钟网络是关关的。插入的时钟门控单元不仅能通过关关时钟网络而显著的降低功耗表，还有其他几个沉要的职能： 　　

①D触发器的时钟输入端口对毛刺敏感，门控单元能有效地滤除信号EN的毛刺，从而确保进入D触发器时钟端口的ENCLK信号不会出现毛刺，预防因竞争而导致触发器产生谬误的状态变动。 　　

②锁存器的插入增长了ENL信号的延时。 　　

③对于n位寄放器组，n条反馈连线和n个多路选择器被一个门控单元所取代，不仅带来面 积上的节俭，降低后端布线的拥塞，同时又进一步降低了功耗。

选取此种方式，可实现最高工作频率410MHz，数据吞吐率5.23Gbps，功耗为58 mW，齐全解决了AES ASIC的功耗高的问题